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  1. 学術雑誌論文
  2. 5 技術(工学)

FPGA Implementation of Hardware-Oriented Chaotic Boltzmann Machines

http://hdl.handle.net/10228/0002001309
http://hdl.handle.net/10228/0002001309
7ed98d7f-e0a4-4580-9da7-334a777ba773
名前 / ファイル ライセンス アクション
10444487.pdf 10444487.pdf (2.4 MB)
アイテムタイプ 共通アイテムタイプ(1)
公開日 2025-02-14
タイトル
タイトル FPGA Implementation of Hardware-Oriented Chaotic Boltzmann Machines
言語 en
その他のタイトル
その他のタイトル FPGA implementation of hardware-oriented chaotic Boltzmann machines
言語 en
著者 Kawashima, Ichiro

× Kawashima, Ichiro

en Kawashima, Ichiro
Kawashima, I.

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森江, 隆

× 森江, 隆

WEKO 1615
e-Rad_Researcher 20294530
Scopus著者ID 7005143434
九工大研究者情報 339

en Morie, Takashi

ja 森江, 隆

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田向, 権

× 田向, 権

WEKO 6059
e-Rad_Researcher 90432955
Scopus著者ID 7801453348
ORCiD 0000-0002-3669-1371
九工大研究者情報 100000641

en Tamukoh, Hakaru

ja 田向, 権

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著作権関連情報
権利情報Resource https://creativecommons.org/licenses/by/4.0/
権利情報 IEEE is not the copyright holder of this material. Please follow the instructions via https://creativecommons.org/licenses/by/4.0/ to obtain full-text articles and stipulations in the API documentation.
抄録
内容記述タイプ Abstract
内容記述 Boltzmann machines (BMs) are useful in various applications but are limited by their requirement to generate random numbers. In contrast, chaotic Boltzmann machines (CBMs) are neural networks that imitate the stochastic behavior of BMs with the chaotic dynamics and deterministic behavior, without random numbers. CBMs can potentially require fewer hardware resources than the original algorithms due to the unnecessity of random number generators. In this study, hardware-oriented algorithms and a differential multiply-accumulation operation are proposed to overcome the difficulties of implementing CBMs on field-programmable gate arrays (FPGAs). A hardware-oriented algorithm for CBMs, which includes fixed-point operations and shift operations, is proposed to reduce hardware resource utilization in the implemented circuits. In particular, the differential multiply-accumulate operation allows us to implement the multiply-accumulate operation with block random access memory and digital signal processors to reduce the consumption of lookup tables and flip-flops in FPGAs without losing the calculation speed. Our proposed approach was evaluated in numerical simulations, logical synthesis, and FPGA implementation. The calculation speed of FPGA-implemented CBMs was compared with software-implemented CBMs, which resulted in 1 / 6,500 of calculation time reduction in a 300-neuron CBM. Moreover, 2,048 neurons of CBM were realized by the logical synthesis. Therefore, the proposed hardware implementation of CBMs was shown to be feasible. The proposed CBMs can solve combinatorial optimization problems at a larger scale with fewer resources.
言語 en
書誌情報 en : IEEE Access

巻 8, p. 204360-204377, 発行日 2020-11-09
出版社
出版者 IEEE
キーワード
主題Scheme Other
主題 Chaotic Boltzmann machines
キーワード
主題Scheme Other
主題 combinatorial optimization problems
キーワード
主題Scheme Other
主題 Ising model
キーワード
主題Scheme Other
主題 field-programmable gate array
言語
言語 eng
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_6501
資源タイプ journal article
出版タイプ
出版タイプ VoR
出版タイプResource http://purl.org/coar/version/c_970fb48d4fbd8a85
DOI
識別子タイプ DOI
関連識別子 https://doi.org/10.1109/ACCESS.2020.3036882
助成情報
助成機関識別子タイプ Crossref Funder
助成機関名 国立研究開発法人新エネルギー・産業技術総合開発機構
言語 ja
助成機関名 New Energy and Industrial Technology Development Organization
言語 en
プログラム情報識別子タイプ Crossref Funder
プログラム情報識別子タイプURI https://doi.org/10.13039/501100001863
ISSN
収録物識別子タイプ EISSN
収録物識別子 2169-3536
研究者情報
URL https://hyokadb02.jimu.kyutech.ac.jp/html/100000641_ja.html
論文ID(連携)
値 10444487
連携ID
値 12626
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Ver.1 2025-02-14 01:32:11.196100
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