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  1. 学会・会議発表論文
  2. 学会・会議発表論文

New Measurement Base De-embedded CPU Load Model for Power Delivery Network Design

http://hdl.handle.net/10228/5794
http://hdl.handle.net/10228/5794
454c63ed-fa67-4ac4-b7b9-e89955ec0f4c
名前 / ファイル ライセンス アクション
nperc62.pdf nperc62.pdf (890.2 kB)
アイテムタイプ 会議発表論文 = Conference Paper(1)
公開日 2016-09-13
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_5794
資源タイプ conference paper
タイトル
タイトル New Measurement Base De-embedded CPU Load Model for Power Delivery Network Design
言語 en
言語
言語 eng
著者 Okano, Motochika

× Okano, Motochika

WEKO 16493

en Okano, Motochika

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Watanabe, Koji

× Watanabe, Koji

WEKO 16494

en Watanabe, Koji

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内藤, 正路

× 内藤, 正路

WEKO 592
e-Rad_Researcher 60264131
Scopus著者ID 7101921028
九工大研究者情報 73

en Naitoh, Masamichi

ja 内藤, 正路

ja-Kana ナイトウ, マサミチ

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大村, 一郎

× 大村, 一郎

WEKO 16176
e-Rad_Researcher 10510670
Scopus著者ID 7003814580
九工大研究者情報 69

en Omura, Ichiro

ja 大村, 一郎

ja-Kana オオムラ, イチロウ

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抄録
内容記述タイプ Abstract
内容記述 CPU load model including on-chip wiring and package interconnection has been required for printed circuit board (PCB) design of digital products according to the improvement in the speed of CPU operation in recent years. Especially, accurate power delivery network (PDN) information inside CPU is indispensable for PCB design according to requirement of low-impedance and the broadband (from DC to GHz) from the inside of CPU to DC-DC converter. While the detailed impedance information inside CPUs is not disclosed to PCB board designers with the complicated back-end and front-end production design for CPU chip and package. This paper aims to establish new methodology to extract CPU load model with combination of measurement and simulation. The method is simple yet powerful for high-end CPU board design.
備考
内容記述タイプ Other
内容記述 2015 9th International Conference on Power Electronics and ECCE Asia (ICPE-ECCE Asia 2015), June 1-5, 2015, Seoul, South Korea
書誌情報 2015 9th International Conference on Power Electronics and ECCE Asia (ICPE-ECCE Asia)

p. 2288-2293, 発行日 2015-06
出版社
出版社 IEEE
DOI
関連タイプ isVersionOf
識別子タイプ DOI
関連識別子 info:doi/10.1109/ICPE.2015.7168125
ISSN
収録物識別子タイプ EISSN
収録物識別子 2150-6086
著作権関連情報
権利情報 IEEE
キーワード
主題Scheme Other
主題 CPU Load Model
キーワード
主題Scheme Other
主題 De-embedded
キーワード
主題Scheme Other
主題 Power delivery network
キーワード
主題Scheme Other
主題 Target impedance
出版タイプ
出版タイプ AM
出版タイプResource http://purl.org/coar/version/c_ab4af688f83e57aa
査読の有無
値 yes
連携ID
値 5524
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Ver.1 2023-05-15 14:33:02.748002
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