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  1. 学術雑誌論文
  2. 5 技術(工学)

Vernier ring based pre-bond through silicon vias test in 3D ICs

http://hdl.handle.net/10228/00007524
http://hdl.handle.net/10228/00007524
8506c707-4180-44e6-aaae-022c4712063c
名前 / ファイル ライセンス アクション
elex.14.20170590.pdf elex.14.20170590.pdf (2.5 MB)
Item type 学術雑誌論文 = Journal Article(1)
公開日 2020-01-10
資源タイプ
資源タイプ識別子 http://purl.org/coar/resource_type/c_6501
資源タイプ journal article
タイトル
タイトル Vernier ring based pre-bond through silicon vias test in 3D ICs
言語 en
その他のタイトル
その他のタイトル Vernier Ring Based Pre-bond Through Silicon Vias Test in 3D ICs
言語 en
言語
言語 eng
著者 Ni, Tianming

× Ni, Tianming

WEKO 26046

en Ni, Tianming
Ni, T.

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Nie, Mu

× Nie, Mu

WEKO 26047

en Nie, Mu
Nie, M.

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Liang, Huaguo

× Liang, Huaguo

WEKO 26048

en Liang, Huaguo
Liang, H.

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Bian, Jingchang

× Bian, Jingchang

WEKO 26049

en Bian, Jingchang
Bian, J.

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Xu, Xiumin

× Xu, Xiumin

WEKO 26050

en Xu, Xiumin
Xu, X.

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Fang, Xiangsheng

× Fang, Xiangsheng

WEKO 26051

en Fang, Xiangsheng
Fang, X.

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Huang, Zhengfeng

× Huang, Zhengfeng

WEKO 26052

en Huang, Zhengfeng
Huang, Z.

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温, 暁青

× 温, 暁青

WEKO 1143
e-Rad 20250897
Scopus著者ID 7201738030
九工大研究者情報 300

en Wen, Xiaoqing

ja 温, 暁青

ja-Kana オン, ギョウセイ


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抄録
内容記述タイプ Abstract
内容記述 Defects in TSV will lead to variations in the propagation delay of the net connected to the faulty TSV. A non-invasive Vernier Ring based method for TSV pre-bond testing is proposed to detect resistive open and leakage faults. TSVs are used as capacitive loads of their driving gates, then time interval compared with the fault-free TSVs will be detected. The time interval can be detected with picosecond level resolution, and digitized into a digital code to compare with an expected value of fault-free. Experiments on fault detection are presented through HSPICE simulations using realistic models for a 45 nm CMOS technology. The results show the effectiveness in the detection of time interval 10 ps, resistive open defects 0.2 kΩ above and equivalent leakage resistance less than 18 MΩ. Compared with existing methods, detection precision, area overhead, and test time are effectively improved, furthermore, the fault degree can be digitalized into digital code.
言語 en
書誌情報 IEICE Electronics Express

巻 14, 号 18, p. 20170590-1-20170590-11, 発行日 2017-09-25
出版社
出版者 電子情報通信学会
DOI
関連タイプ isIdenticalTo
識別子タイプ DOI
関連識別子 https://doi.org/10.1587/elex.14.20170590
CRID
関連タイプ isIdenticalTo
識別子タイプ URI
関連識別子 https://cir.nii.ac.jp/crid/1390001205220482944
日本十進分類法
主題Scheme NDC
主題 549
ISSN
収録物識別子タイプ EISSN
収録物識別子 1349-2543
著作権関連情報
権利情報 Copyright (c) 2017 by The Institute of Electronics, Information and Communication Engineers
キーワード
主題Scheme Other
主題 3D IC
キーワード
主題Scheme Other
主題 TSV
キーワード
主題Scheme Other
主題 pre-bond
キーワード
主題Scheme Other
主題 testing
キーワード
主題Scheme Other
主題 time interval
キーワード
主題Scheme Other
主題 digital code
出版タイプ
出版タイプ VoR
出版タイプResource http://purl.org/coar/version/c_970fb48d4fbd8a85
査読の有無
値 yes
研究者情報
URL https://hyokadb02.jimu.kyutech.ac.jp/html/300_ja.html
論文ID(連携)
値 10320902
連携ID
値 8033
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Ver.1 2023-05-15 14:07:34.816019
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